本方案中采用的CPLD芯片为EPM7128-84,将频率信号接入CLK端,该频率决定了轮循的频率;将需要轮循的通道个数chanl_num写入I/O端,该个数决定了同时采集的通道数;将相应得控制信号接入,控制信号决定了CPLD的工作方式;使用VHDL语言编写循环程序,然后通过下载线下载到芯片中,CPLD即可实现地址轮循的功能。下图为6个通道轮循的仿真图。
图3 六个通道地址轮循的仿真图
本方案中采用的CPLD芯片为EPM7128-84,将频率信号接入CLK端,该频率决定了轮循的频率;将需要轮循的通道个数chanl_num写入I/O端,该个数决定了同时采集的通道数;将相应得控制信号接入,控制信号决定了CPLD的工作方式;使用VHDL语言编写循环程序,然后通过下载线下载到芯片中,CPLD即可实现地址轮循的功能。下图为6个通道轮循的仿真图。
图3 六个通道地址轮循的仿真图